逻辑门:修订间差异

来自WHY42
imported>Soleverlee
以“逻辑门是在集成电路上的基本组件。简单的逻辑门可由晶体管组成。这些晶体管的组合可以使代表两种信号的高低电平在通过...”为内容创建页面
 
imported>Soleverlee
无编辑摘要
第1行: 第1行:
逻辑门是在集成电路上的基本组件。简单的逻辑门可由晶体管组成。这些晶体管的组合可以使代表两种信号的高低电平在通过它们之后产生高电平或者低电平的信号。高、低电平可以分别代表逻辑上的“真”与“假”或二进制当中的1和0,从而实现逻辑运算。
逻辑门是在集成电路上的基本组件。简单的逻辑门可由晶体管组成。这些晶体管的组合可以使代表两种信号的高低电平在通过它们之后产生高电平或者低电平的信号。高、低电平可以分别代表逻辑上的“真”与“假”或二进制当中的1和0,从而实现逻辑运算。
== 符號表 ==
{| class="wikitable"
!类型
![[美国国家标准学会|ANSI]]及[[电气电子工程师学会|IEEE]]标准
![[国际电工委员会|IEC]]标准
!名称
!说明
![[逻辑函数]]表示!
!真值表
|-
|NOT||[[File:128px-NOT_ANSI.svg.png|NOT]]||[[File:128px-IEC_NOT.svg.png|NOT]]||「非」门||輸入的高低狀態會逆轉。||<math>\bar{A}</math>||
{| class="wikitable" align=right
|- bgcolor="#ddeeff" align="center"
|'''输入''' || '''输出'''
|- bgcolor="#ddeeff" align="center"
| A || NOT A
|- bgcolor="#ddffdd" align="center"
|0 || 1
|- bgcolor="#ddffdd" align="center"
|1 || 0
|}
|-
|'''[[与门|AND]]'''||[[File:AND_ANSI.svg|128px|AND]]||[[File:IEC_AND.svg|AND]]||「与」门╱「及」閘╱「且」閘||所有輸入為高時,才會有高的輸出。<br />一低出低。||<math>A \cdot B</math>||
{| class="wikitable" align=right
|- bgcolor="#ddeeff" align="center"
|colspan=2|'''输入''' || '''输出'''
|- bgcolor="#ddeeff" align="center"
| A || B || A AND B
|- bgcolor="#ddffdd" align="center"
|0 || 0 || 0
|- bgcolor="#ddffdd" align="center"
|0 || 1 || 0
|- bgcolor="#ddffdd" align="center"
|1 || 0 || 0
|- bgcolor="#ddffdd" align="center"
|1 || 1 || 1
|}
|-
|'''[[与非门|NAND]]'''||[[File:NAND_ANSI.svg|128px|NAND]]||[[File:IEC_NAND.svg|NAND]]||「与非」门╱「反及」閘╱「非與」閘╱「反且」閘||所有输入为高时,才会有低的输出。<br />一低出高。||<math>\overline{A\cdot B}</math>||
{| class="wikitable" align=right
|- bgcolor="#ddeeff" align="center"
|colspan=2|'''输入''' || '''输出'''
|- bgcolor="#ddeeff" align="center"
| A || B || A NAND B
|- bgcolor="#ddffdd" align="center"
|0 || 0 || 1
|- bgcolor="#ddffdd" align="center"
|0 || 1 || 1
|- bgcolor="#ddffdd" align="center"
|1 || 0 || 1
|- bgcolor="#ddffdd" align="center"
|1 || 1 || 0
|}


|-
|'''[[或门|OR]]'''||[[File:OR_ANSI.svg|128px|OR]]||[[File:IEC_OR.svg|OR]]||「或」门/「或」閘||所有输入为低时,才会有低的输出。<br />一高出高。||<math>A + B \, </math>||
{| class="wikitable" align=right
|- bgcolor="#ddeeff" align="center"
|colspan=2|'''输入''' || '''输出'''
|- bgcolor="#ddeeff" align="center"
| A || B || A OR B
|- bgcolor="#ddffdd" align="center"
|0 || 0 || 0
|- bgcolor="#ddffdd" align="center"
|0 || 1 || 1
|- bgcolor="#ddffdd" align="center"
|1 || 0 || 1
|- bgcolor="#ddffdd" align="center"
|1 || 1 || 1
|}
|-
|'''[[或非门|NOR]]'''||[[File:NOR_ANSI.svg|128px|NOR]]||[[File:IEC_NOR.svg|NOR]]||「或非」门╱「反或」閘╱「非或」閘╱「反或」閘||所有输入为低时,才会有高的输出。<br />一高出低。||<math>\overline{A + B}</math>||
{| class="wikitable" align=right
|- bgcolor="#ddeeff" align="center"
|colspan=2|'''输入''' || '''输出'''
|- bgcolor="#ddeeff" align="center"
| A || B || A NOR B
|- bgcolor="#ddffdd" align="center"
|0 || 0 || 1
|- bgcolor="#ddffdd" align="center"
|0 || 1 || 0
|- bgcolor="#ddffdd" align="center"
|1 || 0 || 0
|- bgcolor="#ddffdd" align="center"
|1 || 1 || 0
|}
|-
|'''[[异或门|XOR]]'''||[[File:XOR_ANSI.svg|128px|XOR]]||[[File:IEC_XOR.svg|XOR]]||「异或」门╱「互斥或」閘||只有其中一个输入为高时,输出为高;否则为低。||<math>A \oplus B</math>||
{| class="wikitable" align=right
|- bgcolor="#ddeeff" align="center"
|colspan=2|'''输入''' || '''输出'''
|- bgcolor="#ddeeff" align="center"
| A || B || A XOR B
|- bgcolor="#ddffdd" align="center"
|0 || 0 || 0
|- bgcolor="#ddffdd" align="center"
|0 || 1 || 1
|- bgcolor="#ddffdd" align="center"
|1 || 0 || 1
|- bgcolor="#ddffdd" align="center"
|1 || 1 || 0
|}
|-
|'''[[同或门|XNOR]]'''||[[File:XNOR_ANSI.svg|128px|XNOR]]||[[File:IEC_XNOR.svg|XNOR]]||「同或」门╱「反互斥或」閘╱「互斥反或」閘╱「互斥或非」閘||只有其中一个输入为高时,输出为低;否则为高。||<math>\overline{A \oplus B}</math><br />或<math>{A \odot B}</math>||
{| class="wikitable" align=right
|- bgcolor="#ddeeff" align="center"
|colspan=2|'''输入''' || '''输出'''
|- bgcolor="#ddeeff" align="center"
| A || B || A XNOR B
|- bgcolor="#ddffdd" align="center"
|0 || 0 || 1
|- bgcolor="#ddffdd" align="center"
|0 || 1 || 0
|- bgcolor="#ddffdd" align="center"
|1 || 0 || 0
|- bgcolor="#ddffdd" align="center"
|1 || 1 || 1
|}
|}


[[Category:Math]]
[[Category:Math]]

2015年4月2日 (四) 16:15的版本

逻辑门是在集成电路上的基本组件。简单的逻辑门可由晶体管组成。这些晶体管的组合可以使代表两种信号的高低电平在通过它们之后产生高电平或者低电平的信号。高、低电平可以分别代表逻辑上的“真”与“假”或二进制当中的1和0,从而实现逻辑运算。

符號表

类型 ANSIIEEE标准 IEC标准 名称 说明 逻辑函数表示! 真值表
NOT NOT NOT 「非」门 輸入的高低狀態會逆轉。 [math]\displaystyle{ \bar{A} }[/math]
输入 输出
A NOT A
0 1
1 0
AND AND AND 「与」门╱「及」閘╱「且」閘 所有輸入為高時,才會有高的輸出。
一低出低。
[math]\displaystyle{ A \cdot B }[/math]
输入 输出
A B A AND B
0 0 0
0 1 0
1 0 0
1 1 1
NAND NAND NAND 「与非」门╱「反及」閘╱「非與」閘╱「反且」閘 所有输入为高时,才会有低的输出。
一低出高。
[math]\displaystyle{ \overline{A\cdot B} }[/math]
输入 输出
A B A NAND B
0 0 1
0 1 1
1 0 1
1 1 0
OR OR OR 「或」门/「或」閘 所有输入为低时,才会有低的输出。
一高出高。
[math]\displaystyle{ A + B \, }[/math]
输入 输出
A B A OR B
0 0 0
0 1 1
1 0 1
1 1 1
NOR NOR NOR 「或非」门╱「反或」閘╱「非或」閘╱「反或」閘 所有输入为低时,才会有高的输出。
一高出低。
[math]\displaystyle{ \overline{A + B} }[/math]
输入 输出
A B A NOR B
0 0 1
0 1 0
1 0 0
1 1 0
XOR XOR XOR 「异或」门╱「互斥或」閘 只有其中一个输入为高时,输出为高;否则为低。 [math]\displaystyle{ A \oplus B }[/math]
输入 输出
A B A XOR B
0 0 0
0 1 1
1 0 1
1 1 0
XNOR XNOR XNOR 「同或」门╱「反互斥或」閘╱「互斥反或」閘╱「互斥或非」閘 只有其中一个输入为高时,输出为低;否则为高。 [math]\displaystyle{ \overline{A \oplus B} }[/math]
[math]\displaystyle{ {A \odot B} }[/math]
输入 输出
A B A XNOR B
0 0 1
0 1 0
1 0 0
1 1 1